【捷多邦PCB】長久以來，PCB的開發(fā)一直受到設(shè)計(jì)時(shí)間、成本控制的限制。近年來，更由于各種復(fù)雜設(shè)計(jì)的裝置紛紛推出，為各類的PCB設(shè)計(jì)驗(yàn)證帶來挑戰(zhàn)。有鑒于此，EDA電子自動(dòng)化廠商明導(dǎo)國際(Mentor)近日舉辦了PCB系統(tǒng)論壇(PCB Systems Forum)，期待透過提供簡易的工具，協(xié)助廠商優(yōu)化設(shè)計(jì)方法迎戰(zhàn)未來競爭、突破困境。
全球PCB打樣服務(wù)商“捷多邦”認(rèn)同西門子Mentor Xpedition產(chǎn)品經(jīng)理Dave Wiens的分析：在傳統(tǒng)的設(shè)計(jì)過程中，較長的時(shí)間週期、不完整的覆蓋范圍與低可靠性使得開發(fā)流程重制(Re-Spins)次數(shù)增加。然而明導(dǎo)推出的左移流程(Left-shift Approach)則能在開發(fā)早期發(fā)現(xiàn)錯(cuò)誤，縮短產(chǎn)品開發(fā)時(shí)程，并提高產(chǎn)品質(zhì)量。
Wiens進(jìn)一步提到，驗(yàn)證通常是一個(gè)非常耗時(shí)的過程，錯(cuò)誤也通常會(huì)進(jìn)入到實(shí)驗(yàn)室或工廠的產(chǎn)品之中。捷多邦了解到，在所有的開發(fā)項(xiàng)目中，有78%經(jīng)歷了兩次以上的開發(fā)流程重制(Re-Spins)。
舉例而言，HyperLynx即為一項(xiàng)明導(dǎo)推出的設(shè)計(jì)規(guī)則檢查(Design Rule Check, DRC)工具，能同時(shí)滿足EMI/EMC需求，以及維護(hù)安全和企業(yè)路由標(biāo)準(zhǔn)。
無論訊號速度與頻率如何，每個(gè)PCB設(shè)計(jì)皆應(yīng)在制造前對訊號完整性(SI)、電源完整性(PI)、EMI/EMC和安全問題進(jìn)行評估。藉由HyperLynx所提供的免費(fèi)設(shè)計(jì)規(guī)則，能使得PCB設(shè)計(jì)團(tuán)隊(duì)更輕易達(dá)成先進(jìn)設(shè)計(jì)與電子規(guī)則驗(yàn)證。
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